好好玩,不要焦虑,不要内耗

#毕业季,给职场新人一些建议#毕业季,大家都好好玩,找到工作的就好好享受一下最后的学生快乐时光,没有找到工作的也不好慌,学中玩,玩中学,加油各位优秀。
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上学十余载,今年终到头我的学生时代即将圆满结束。所谓圆满就是不断遇到困难并战胜困难步步为营的这种状态。我的大学和硕士七年时光,我可以看到我在一直进步。大学时候因为自己是民办本科,一直没有自信。大学觉醒势必要通过学习改变命运,考研时候是我第一次认真对待学习全力以赴的状态。要我在经历一次考研吧?算了算了,怕了。那时候回想起来真的不知道自己当时那么大的拼搏精神,要我现在再来一次,我没有那么大的动力了。感谢那个为四六级和考研奋斗的我。读研时同样很精彩啊!印象最深的事情就是有三个。第一是实习,孤身一人到北京,体验打工人生活。很刺激很辛苦,到现在回想起来还是不错的。迟到,摸鱼,早退的人是我。加班干项目到十点的人也是我。第二是论文,开题没过让我怀疑自己。自那次起,全身心投入规范自己。在实验室朝九晚十的干。很枯燥也很单纯没有别的杂事,只按着进度把当下工作完成就好。既单纯又充实。第三是秋招,跑了十多个招聘会,投了上千次简历,面试十多家。从激动兴奋,到疲惫麻木,再到拿到offer时的舒畅。很精彩啊,真的很精彩。这些年,感谢我一直在马不停蹄,走走停停。当然,毕业只是另一种开始,今后希望自己继续保持青春斗志,奋发向上。也要爱自己爱的人,也要注重感恩,也要提高情商,成为想成为的人,活成自己喜欢的样子。  
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 先说提前实习,已经是两个月前的事情了。下面说的一些信息不能包含隐私信息,所有一些点就会比较正式和笼统和XX,大概分为,一.你学校学的跟嵌入式跟公司用的有什么不一样。  二.生活上         一、001,工具链上,很多公司都会让公司配置的发的那种电脑禁止联网,因为有一些工具比如说keil,pads,matlab对这种盈利的如果有非法的那种数据传输到网上会起诉的,这种就即使是社区版的就没有用了。一般就是本地断网,资料在一个服务器上,上网的在另一个服务器上,通过内网连接不同服务器。好多说其他软件,比如说加密软件公司也 要买,所以想带资料出去,noway。     002,你在学校里做的基本就是application应用层的(楼主只是本科生,只知道做过这些),比如说小车,机甲大师,飞控,智能家居。具体到公司就有可能会负责其他东西的了。这时候就会要根据行业,公司,岗位具体而分的了。       说的有点空,我只拿我例子,比如说一个没用到过的芯片,他可能只有寄存器手册,但是公司跑的case是公司的老工程师写的,keil上可能没有任何注释或有一点关键的英文注释,这时候你就要返回参考手册查每个位怎么配寄存器,这个寄存器。这个时候就是说,你学stm32什么HAL  LL  标准库,区分的没有意义,他们只是库函数,了解一个然后触类旁通,深入还要寄存器编写。  当然最重要的是C语言基础,看了下CORETX-M3权威指南,一页一页读,感到了有点不同。         还有些,con寄存器,离date寄存器资料中好远,资料又没写关联,默认你会,配了半天,串口打印的数据就没动过……真没办法,又要厚着脸皮问老工程师问出来的,有时候老工程师也很烦,所以我自己也经常总结,和找资料,看有没有过去的例子,做不出才问     002_V2,既上。上次我拿XX卡做相关功能,XX的physical和cmd文档以及流程文档真的是全英文又陌生词汇,你要知道一部分资料在内网,我还没办法用翻译,楼主英语过了四级,六级没过,啃得挺吃力的,还要一边看一边用logic查波形,看懂了一部分。     二、嵌入式研发部很累,要认清这个现实,我是在用命赚钱,(wlb和小康以上的请自动略过这段话)我的工时见图1。实习,一周加了四天到4.5天,有时候周六也要去,算做大小周吧。这个还没算早上早到的和中间休息晚上休息的时间。其实,压力是很大的,我肯定是认同自己能力的,因为我自己是面了这么多也挑了好几个的。但是解决bug和debug能力肯定比不上那些老工程师,这个我只能用时间堆,写日志,周报,总结和列表一些重要的问题问mentor。加班后,离的近的就晚上9点,远的就十点。远的早上还要早起,加班后真的就如一条死狗一样躺在床上 ……20250524记----------------------------------------分割线-----------------------------------------------------------------------更新:        谈一些比较具体的事,比如说XX卡,他在2.0的时候,初始时CLK如果用PLL好像是20MHZ,然后在LOGIC采样,如果用100MHZ,采样率为20MBPS,那么采样时间为5秒,本来CLK应该是占空比0.5的矩形20M。我确定HOST 与SLAVE的通信已开始,配置好电压数据和厂商信息,但是为什么CLK有的占空比为0.3和0.6呢,所以我先复位,再开始单步调试,调试进入WORK状态了,初始的时钟跟WORK的时钟不一样,暂时没测出。后面是想这真的是杂波吗?然后被MT指导,是采样率不够,要先开始1G采样数,拿20M采样率,采样50S,等DEBUG运行再先确认初始成功,再复位,重新运行到断点查看波形。        谈总体上的事,假设是一个大的任务,你做的是一个很小项目的一部分,如果是一个很完善的产品或小产品,就有可能被丢给你完全自己解决。如果说这个任务被分配到这个部分的这个小组,LEADER会将工作分到10左右年工程师手上,再带5到10年和1到3年的,有时,他做的指标可能是市场部做的,也有可能是其他部门做的,你做好后指标对不对,需求搞没搞清楚又会跟其他部门对接,拿软件也好,发邮件也好,确实有时候信息就是沟通的不完全,需求不完全就是你上个指标完成了,突然他会让你加入新的指标,DDL在那突然加入新的指标,是真的做不了一点,我的建议起始就是再三确认需求假设有模糊的地方和工作留痕。        还应该记录并警告一下自己,真的就有时看了一上午和一下午代码,找问题,回去真的很累。可是你想要赚钱,公司不会原地等待你,技术没有进步就是会被替代,你要学习。此贴终结,可能试用期过后,假设过了还会有个帖子,没过就继续找工作去了。       
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创作者周榜

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