04-06 17:38 台湾成功大学 数字IC前端设计 发布于北京
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2025 Day 22~24 【Verilog进阶挑战03 跨时钟域传输、Verilog企业真题02
完成项目：
Day 22完成: 【Verilog进阶挑战03】LV47 格雷码计数器
Day 23完成: 【Verilog进阶挑战03】LV46 同步FIFO
Day 24完成: 【Verilog进阶挑战03】LV45 异步FIFO、【Verilog企业真题02】LV68 同步FIFO
Day 22~25学习: 複习gray code及gray code counter、sync/async FIFO的原理与实践
(其中async FIFO中的gray code counter的实现与"Simulation and Synthesis Techniques for Asynchronous FIFO Design"的Style #2不同，会差一个cycle，但习惯了...)
Day 22完成: 【Verilog进阶挑战03】LV47 格雷码计数器
Day 23完成: 【Verilog进阶挑战03】LV46 同步FIFO
Day 24完成: 【Verilog进阶挑战03】LV45 异步FIFO、【Verilog企业真题02】LV68 同步FIFO
Day 22~25学习: 複习gray code及gray code counter、sync/async FIFO的原理与实践
(其中async FIFO中的gray code counter的实现与"Simulation and Synthesis Techniques for Asynchronous FIFO Design"的Style #2不同，会差一个cycle，但习惯了...)
2025-04-06
在牛客打卡22天，今天学习：刷题 2 道/代码提交 22 次
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