牛客482115445号
2022-11-27 23:16 广东工业大学 IC验证工程师
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else if (valid_a &&ready_a) data_out <= data_out + data_in; 这句好像不太对啊，这表示在时钟来的时候valid_a和ready_a都要是高电平才能进行计算，但是时序图里，时钟来的时候，ready_a已经变为低电平了，怎么会进行计算呢？求教
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