糊涂的沸羊羊在干饭 level
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黑龙江大学
2024
FPGA工程师
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VL34
整数倍数据位宽转换8to16
2023-08-22
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Verilog
VL34
整数倍数据位宽转换8to16
2023-08-22
答案正确
< 1ms
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Verilog
VL33
非整数倍数据位宽转换8to12
2023-08-22
答案正确
< 1ms
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Verilog
VL32
非整数倍数据位宽转换24to128
2023-08-22
答案正确
< 1ms
0K
Verilog
VL31
数据累加输出
2023-08-22
答案正确
< 1ms
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Verilog
VL31
数据累加输出
2023-08-22
答案正确
< 1ms
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Verilog
VL28
输入序列不连续的序列检测
2023-08-17
答案正确
< 1ms
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Verilog
VL28
输入序列不连续的序列检测
2023-08-17
答案正确
< 1ms
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Verilog
VL27
不重叠序列检测
2023-08-17
答案正确
< 1ms
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Verilog
VL26
含有无关项的序列检测
2023-08-17
答案正确
< 1ms
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Verilog
VL25
输入序列连续的序列检测
2023-08-15
答案正确
< 1ms
0K
Verilog
234316
根据状态转移图实现时序电路
2023-08-15
答案正确
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Verilog
234351
边沿检测
2023-08-09
答案正确
< 1ms
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Verilog
234350
ROM的简单实现
2023-08-09
答案正确
< 1ms
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Verilog
234316
根据状态转移图实现时序电路
2023-08-09
答案正确
< 1ms
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Verilog
234315
根据状态转移表实现时序电路
2023-08-09
答案正确
< 1ms
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Verilog
234305
4位数值比较器电路
2023-08-09
答案正确
< 1ms
0K
Verilog
234349
使用函数实现数据大小端转换
2023-08-09
答案正确
< 1ms
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Verilog
234348
使用子模块实现三输入数的大小比较
2023-08-09
答案正确
< 1ms
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Verilog
234347
使用generate…for语句简化代码
2023-08-09
答案正确
< 1ms
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Verilog

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