华为主管面

一面面试官问八股比较多一些，二面问项目更多，也会穿插八股，二面还有现场给出题目要做，三面是主管面，面试官人都很好，一面每次答完问题对或者不对都会给很好的反馈，面试体验整体很棒，现在已入池一面50分钟，二面45分钟，三面35-40分钟下面是一二面（技术面）面经：实习和项目1.设计的Buck电路拓扑结构，防反接（肖特基二极管）和抗浪涌的实现(先后用了TVS和浪涌保护器)，用TVS和浪涌保护器对应的钳位到的浪涌电压是多少？2.Buck还测试哪些参数（纹波、动态响应、EMI、效率、过冲、上升沿时间、高温）3.实习DC-DC为什么选型TPS534360、电感选型4.Buck的layout需要注意什么（电容电感和DC-DC芯片靠近放置、输入电容靠近引脚、feedback线远离电容电感和芯片等高EMI区域避免干扰、电源线要粗、回流路径短）5.为什么电容电感和DC-DC芯片靠近放置（保证电源信号顺畅回流路径短，并把高EMI设备放在一起远离信号部分）6.对比buck和ldo（成本、layout难度、效率、应用场景）7.计算：分别给了LDO和buck的应用场景，计算效率和损耗8.UART为什么用DMA+IDLE替代中断接收？9.项目中用的四层板介绍？10.实习做过哪些可靠性（静电、电源跌落、高低温、电源反接、过压供电）11.项目硬件的模块拓扑结构（TP4056充电管理、电池、开关机电路、LDO、MCU和其他传感器）12.MPU6050和stm32通信协议（I2C）、通信速率、示波器抓到起始位和结束位波形13.项目中调试用到的设备（示波器、万用表）14.项目调试（分别介绍了DC-DC实习测浪涌和手表项目打板调试的问题）15.用过哪些仿真软件（multisim走天下）16.实习时候EMC专题学习学了什么（静电、浪涌、阻抗不匹配）17.Verilog HDL实现一个序列检测器，大概写思路（我用状态机模型实现）18.Verilog HDL实现一个串口数据帧，大概写思路（我用状态机模型实现）八股1.CMOS和TTL电平标准对比，两者噪声容限情况，TTL能否驱动CMOS？2.介绍传输线模型3.什么是竞争冒险现象4.ADC的分辨率的意义，10位分辨率对应精度是供电电压的多少分之一？5.PLL组成部分（只记得三部分，有一部分是鉴相器了）6.阻抗匹配（始端匹配、终端匹配）7.layout要注意哪些问题？（3W、圆滑、钝角走线、隔层不要平行走线、数字和模拟隔开、大能量电源线粗回流路径要短）8.手撕：用运放搭建减法器电路9.手撕：画出射极跟随器电路10.手撕：画出buck和boost拓扑结构，并写出Vin和Vout关系11.手撕：求一道运放类电路的Vin和Vout关系（深度负反馈虚短虚断秒了）二面反问：1.海思对新人的培养机制和流程2.如果能入职，需要补充学习什么？3.未来三年海思的发展规划主管面确实忘了问的啥了，只记得自己反问的问题反问：1.海思的工作强度和企业文化2.华为海思工作地点，上海青浦？3.贵公司最看重应届生的哪些素质？

📍面试公司：新凯来🕐面试时间：11.5💻面试岗位：软件开发工程师❓面试问题：1、如何解决MD5冲突的问题2、如何使用netlink获取网络信息3、四表五链4、C++ auto推导规则5、智能指针6、右值引用和移动构造函数7、TCP三次握手和四次挥手8、MYSQL间隙锁🙌面试感想：总体不难，但基础不牢，有的题答得不好，估计没了

收到华为云的 hr 的保温电话了，第一次打的时候我手机调了静音没发现，然后我给她回拨了，也是秒接，不知道这算不算有事。问了下三方还在不在、目前 offer 情况、薪资待遇要求、工作地点这些，然后今天看公众号时也是能看到“录用排序中”这一段文字，希望能开到我吧华子，开到我以后给你卖命了😇。

嘿，我最近在招聘网站遇到好些小朋友面试中了，还不怎么清楚面试的流程，我给总结下哈，经供参考哦。1、机考：无固定准备周期，按自身节奏来就好不用纠结“别人准备多久”，有人一周集中刷题通关，也有人花数月扎实打基础，准备时间长不代表效率低，放宽心按自己的进度备考，别陷入焦虑。2、综测：立好“一致人设”，不用追求“完人”给自己立一个人设，注意前后一致性，在一道道咄咄逼人的问题冲刷下，真的很容易找不到北，所以你就突出部分特质就够了，比如团结就是大于创新，别老想着自己是个完人3、HR面试：看似“聊家常”，实则藏细节大多时候会问个人情况、求职意向等家常问题，难度不高，但别掉以轻心——部分HR也会穿插技术问题，...