牛客153556298号
2025-04-14 21:45 西安电子科技大学 FPGA工程师
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不能在cnt为1，2，3的时候直接用d去移位吧。按照题目波形，输入d有可能在这期间变化的，但是输出只针对cnt为0的时候输入的那个数据的处理。在此期间输入的数据不做响应。应该加一个temp_reg 去储存第一个周期输入进来的数据
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