题号 | 题目 | 提交时间 | 状态 | 运行时间 | 占用内存 | 使用语言 | 题解 |
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VL28 |
输入序列不连续的序列检测
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2023-05-08
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答案正确
| < 1ms | 0K | Verilog | |
VL26 |
含有无关项的序列检测
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2023-05-07
|
答案正确
| < 1ms | 0K | Verilog | |
VL25 |
输入序列连续的序列检测
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2023-05-07
|
答案正确
| < 1ms | 0K | Verilog | |
VL27 |
不重叠序列检测
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2023-04-28
|
答案正确
| < 1ms | 0K | Verilog | |
VL27 |
不重叠序列检测
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2023-04-28
|
答案正确
| < 1ms | 0K | Verilog | |
VL27 |
不重叠序列检测
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2023-04-28
|
答案正确
| < 1ms | 0K | Verilog | |
VL27 |
不重叠序列检测
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2023-04-28
|
答案正确
| < 1ms | 0K | Verilog | |
VL27 |
不重叠序列检测
|
2023-04-28
|
答案正确
| < 1ms | 0K | Verilog | |
VL26 |
含有无关项的序列检测
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2023-04-27
|
答案正确
| < 1ms | 0K | Verilog | |
VL25 |
输入序列连续的序列检测
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2023-04-26
|
答案正确
| < 1ms | 0K | Verilog | |
VL25 |
输入序列连续的序列检测
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2023-04-26
|
答案正确
| < 1ms | 0K | Verilog | |
234351 |
边沿检测
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2023-04-26
|
答案正确
| < 1ms | 0K | Verilog | |
234350 |
ROM的简单实现
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2023-04-26
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答案正确
| < 1ms | 0K | Verilog | |
234316 |
根据状态转移图实现时序电路
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2023-04-26
|
答案正确
| < 1ms | 0K | Verilog | |
234316 |
根据状态转移图实现时序电路
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2023-04-26
|
答案正确
| < 1ms | 0K | Verilog | |
234316 |
根据状态转移图实现时序电路
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2023-04-26
|
答案正确
| < 1ms | 0K | Verilog | |
234316 |
根据状态转移图实现时序电路
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2023-04-26
|
答案正确
| < 1ms | 0K | Verilog | |
234315 |
根据状态转移表实现时序电路
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2023-04-25
|
答案正确
| < 1ms | 0K | Verilog | |
234315 |
根据状态转移表实现时序电路
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2023-04-25
|
答案正确
| < 1ms | 0K | Verilog | |
234315 |
根据状态转移表实现时序电路
|
2023-04-25
|
答案正确
| < 1ms | 0K | Verilog |
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