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真题试卷 (81)

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235499	根据RTL图编写Verilog程序	2025-06-20	答案正确	< 1ms	0K	Verilog	题解
235511	并串转换	2024-03-06	答案正确	< 1ms	0K	Verilog	题解
235505	串行进位加法器	2024-03-06	答案正确	< 1ms	0K	Verilog	题解
235497	序列发生器	2024-03-06	答案正确	< 1ms	0K	Verilog	题解
235507	全加器	2024-03-06	答案正确	< 1ms	0K	Verilog	题解
235499	根据RTL图编写Verilog程序	2024-03-06	答案正确	< 1ms	0K	Verilog	题解
235507	全加器	2024-03-05	答案正确	< 1ms	0K	Verilog	题解
235519	乘法与位运算	2024-03-05	答案正确	< 1ms	0K	Verilog	题解
235499	根据RTL图编写Verilog程序	2024-03-05	答案正确	< 1ms	0K	Verilog	题解
235499	根据RTL图编写Verilog程序	2024-03-05	答案正确	< 1ms	0K	Verilog	题解
235523	十六进制计数器	2024-03-05	答案正确	< 1ms	0K	Verilog	题解
234350	ROM的简单实现	2024-02-17	答案正确	< 1ms	0K	Verilog	题解
234309	优先编码器Ⅰ	2024-02-16	答案正确	< 1ms	0K	Verilog	题解
234307	优先编码器电路①	2024-02-16	答案正确	< 1ms	0K	Verilog	题解
234313	用3-8译码器实现全减器	2024-02-16	答案正确	< 1ms	0K	Verilog	题解
234312	使用3-8译码器①实现逻辑函数	2024-02-16	答案正确	< 1ms	0K	Verilog	题解
234311	实现3-8译码器①	2024-02-16	答案正确	< 1ms	0K	Verilog	题解
234314	数据选择器实现逻辑电路	2024-02-16	答案正确	< 1ms	0K	Verilog	题解
234307	优先编码器电路①	2024-02-15	答案正确	< 1ms	0K	Verilog	题解
234313	用3-8译码器实现全减器	2024-02-15	答案正确	< 1ms	0K	Verilog	题解

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