题号 | 题目 | 提交时间 | 状态 | 运行时间 | 占用内存 | 使用语言 | 题解 |
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VL40 |
占空比50%的奇数分频
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2024-05-02
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答案正确
| < 1ms | 0K | Verilog | |
EP9 |
嵌入式小端转大端
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2024-04-21
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答案正确
| 3ms | 412K | C | |
EP8 |
嵌入式机器的大小端
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2024-04-21
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答案正确
| 3ms | 392K | C | |
EP7 |
嵌入式字符串所占空间
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2024-04-21
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答案正确
| 3ms | 460K | C | |
EP6 |
嵌入式连续申明的指针
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2024-04-21
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答案正确
| 2ms | 420K | C | |
EP5 |
嵌入式会改变的指针
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2024-04-21
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答案正确
| 2ms | 448K | C | |
EP4 |
嵌入式关键字const
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2024-04-21
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答案正确
| 2ms | 316K | C | |
235519 |
乘法与位运算
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2024-04-17
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答案正确
| < 1ms | 0K | Verilog | |
235509 |
脉冲同步器(快到慢)
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2024-04-17
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答案正确
| < 1ms | 0K | Verilog | |
235525 |
同步FIFO
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2024-04-17
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答案正确
| < 1ms | 0K | Verilog | |
235513 |
时钟切换
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2024-04-17
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答案正确
| < 1ms | 0K | Verilog | |
235511 |
并串转换
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2024-04-17
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答案正确
| < 1ms | 0K | Verilog | |
235497 |
序列发生器
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2024-04-17
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答案正确
| < 1ms | 0K | Verilog | |
235491 |
使用握手信号实现跨时钟域数据传输
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2024-04-17
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答案正确
| < 1ms | 0K | Verilog | |
235499 |
根据RTL图编写Verilog程序
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2024-04-17
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答案正确
| < 1ms | 0K | Verilog | |
235495 |
编写乘法器求解算法表达式
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2024-04-17
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答案正确
| < 1ms | 0K | Verilog | |
235503 |
任意奇数倍时钟分频
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2024-04-17
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答案正确
| < 1ms | 0K | Verilog | |
235503 |
任意奇数倍时钟分频
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2024-04-17
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答案正确
| < 1ms | 0K | Verilog | |
235503 |
任意奇数倍时钟分频
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2024-04-17
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答案正确
| < 1ms | 0K | Verilog | |
235495 |
编写乘法器求解算法表达式
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2024-04-13
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答案正确
| < 1ms | 0K | Verilog |
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