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真题试卷 (9)

在线编程 (31)

VL1	输出1	2023-08-13	答案正确	< 1ms	0K	Verilog	题解
234316	根据状态转移图实现时序电路	2022-11-06	答案正确	< 1ms	0K	Verilog	题解
234349	使用函数实现数据大小端转换	2022-11-05	答案正确	< 1ms	0K	Verilog	题解
234349	使用函数实现数据大小端转换	2022-11-05	答案正确	< 1ms	0K	Verilog	题解
234305	4位数值比较器电路	2022-06-07	答案正确	< 1ms	0K	Verilog	题解
VL37	时钟分频（偶数）	2022-05-13	答案正确	< 1ms	0K	Verilog	题解
VL31	数据累加输出	2022-05-13	答案正确	< 1ms	0K	Verilog	题解
VL30	数据串转并电路	2022-05-11	答案正确	< 1ms	0K	Verilog	题解
VL30	数据串转并电路	2022-05-11	答案正确	< 1ms	0K	Verilog	题解
VL28	输入序列不连续的序列检测	2022-05-10	答案正确	< 1ms	0K	Verilog	题解
VL27	不重叠序列检测	2022-05-09	答案正确	< 1ms	0K	Verilog	题解
VL26	含有无关项的序列检测	2022-05-09	答案正确	< 1ms	0K	Verilog	题解
VL25	输入序列连续的序列检测	2022-05-09	答案正确	< 1ms	0K	Verilog	题解
235497	序列发生器	2022-05-08	答案正确	< 1ms	0K	Verilog	题解
234350	ROM的简单实现	2022-05-08	答案正确	< 1ms	0K	Verilog	题解
234351	边沿检测	2022-05-08	答案正确	< 1ms	0K	Verilog	题解
234332	移位运算与乘法	2022-05-08	答案正确	< 1ms	0K	Verilog	题解
234332	移位运算与乘法	2022-05-08	答案正确	< 1ms	0K	Verilog	题解
234348	使用子模块实现三输入数的大小比较	2022-05-07	答案正确	< 1ms	0K	Verilog	题解
234348	使用子模块实现三输入数的大小比较	2022-05-07	答案正确	< 1ms	0K	Verilog	题解

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