我是大皇帝 - 个人主页刷题动态

VL56	流水线乘法器	2025-03-19	答案正确	< 1ms	0K	Verilog	题解
235513	时钟切换	2025-03-01	答案正确	< 1ms	0K	Verilog	题解
235511	并串转换	2025-03-01	答案正确	< 1ms	0K	Verilog	题解
235491	使用握手信号实现跨时钟域数据传输	2025-02-28	答案正确	< 1ms	0K	Verilog	题解
235491	使用握手信号实现跨时钟域数据传输	2025-02-28	答案正确	< 1ms	0K	Verilog	题解
235499	根据RTL图编写Verilog程序	2025-02-28	答案正确	< 1ms	0K	Verilog	题解
235499	根据RTL图编写Verilog程序	2025-02-28	答案正确	< 1ms	0K	Verilog	题解
234351	边沿检测	2025-02-27	答案正确	< 1ms	0K	Verilog	题解
234350	ROM的简单实现	2025-02-27	答案正确	< 1ms	0K	Verilog	题解
234350	ROM的简单实现	2025-02-27	答案正确	< 1ms	0K	Verilog	题解
234316	根据状态转移图实现时序电路	2025-02-27	答案正确	< 1ms	0K	Verilog	题解
234315	根据状态转移表实现时序电路	2025-02-27	答案正确	< 1ms	0K	Verilog	题解
234314	数据选择器实现逻辑电路	2025-02-27	答案正确	< 1ms	0K	Verilog	题解
234312	使用3-8译码器①实现逻辑函数	2025-02-27	答案正确	< 1ms	0K	Verilog	题解
234311	实现3-8译码器①	2025-02-27	答案正确	< 1ms	0K	Verilog	题解
234313	用3-8译码器实现全减器	2025-02-27	答案正确	< 1ms	0K	Verilog	题解
234309	优先编码器Ⅰ	2025-02-27	答案正确	< 1ms	0K	Verilog	题解
234308	用优先编码器①实现键盘编码电路	2025-02-27	答案正确	< 1ms	0K	Verilog	题解
234307	优先编码器电路①	2025-02-27	答案正确	< 1ms	0K	Verilog	题解
234306	4bit超前进位加法器电路	2025-02-27	答案正确	< 1ms	0K	Verilog	题解

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