题号 | 题目 | 提交时间 | 状态 | 运行时间 | 占用内存 | 使用语言 | 题解 |
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235507 |
全加器
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2023-09-11
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答案正确
| < 1ms | 0K | Verilog | |
235515 |
状态机与时钟分频
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2023-09-11
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答案正确
| < 1ms | 0K | Verilog | |
235503 |
任意奇数倍时钟分频
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2023-09-11
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答案正确
| < 1ms | 0K | Verilog | |
235511 |
并串转换
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2023-09-11
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答案正确
| < 1ms | 0K | Verilog | |
235493 |
异步复位同步释放
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2023-09-11
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答案正确
| < 1ms | 0K | Verilog | |
235497 |
序列发生器
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2023-09-11
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答案正确
| < 1ms | 0K | Verilog | |
235499 |
根据RTL图编写Verilog程序
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2023-09-11
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答案正确
| < 1ms | 0K | Verilog | |
VL44 |
根据状态转移写状态机-二段式
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2023-09-10
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答案正确
| < 1ms | 0K | Verilog | |
VL43 |
根据状态转移写状态机-三段式
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2023-09-10
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答案正确
| < 1ms | 0K | Verilog | |
VL40 |
占空比50%的奇数分频
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2023-09-09
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答案正确
| < 1ms | 0K | Verilog | |
VL37 |
时钟分频(偶数)
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2023-09-09
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答案正确
| < 1ms | 0K | Verilog | |
VL52 |
加减计数器
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2023-09-09
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答案正确
| < 1ms | 0K | Verilog | |
VL51 |
可置位计数器
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2023-09-09
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答案正确
| < 1ms | 0K | Verilog | |
VL28 |
输入序列不连续的序列检测
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2023-07-28
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答案正确
| < 1ms | 0K | Verilog | |
VL27 |
不重叠序列检测
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2023-07-28
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答案正确
| < 1ms | 0K | Verilog | |
VL27 |
不重叠序列检测
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2023-07-28
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答案正确
| < 1ms | 0K | Verilog | |
VL26 |
含有无关项的序列检测
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2023-07-28
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答案正确
| < 1ms | 0K | Verilog | |
VL25 |
输入序列连续的序列检测
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2023-07-28
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答案正确
| < 1ms | 0K | Verilog | |
234351 |
边沿检测
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2023-07-28
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答案正确
| < 1ms | 0K | Verilog | |
234350 |
ROM的简单实现
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2023-07-28
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答案正确
| < 1ms | 0K | Verilog |
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