题号 | 题目 | 提交时间 | 状态 | 运行时间 | 占用内存 | 使用语言 | 题解 |
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235511 |
并串转换
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2024-10-17
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答案正确
| < 1ms | 0K | Verilog | |
235521 |
自动售卖机
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2024-10-17
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答案正确
| < 1ms | 0K | Verilog | |
VL48 |
多bit MUX同步器
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2024-10-17
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答案正确
| < 1ms | 0K | Verilog | |
VL46 |
同步FIFO
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2024-10-17
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答案正确
| < 1ms | 0K | Verilog | |
VL27 |
不重叠序列检测
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2024-10-17
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答案正确
| < 1ms | 0K | Verilog | |
235523 |
十六进制计数器
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2024-10-17
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答案正确
| < 1ms | 0K | Verilog | |
235517 |
超前进位加法器
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2024-10-17
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答案正确
| < 1ms | 0K | Verilog | |
235517 |
超前进位加法器
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2024-10-17
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答案正确
| < 1ms | 0K | Verilog | |
235517 |
超前进位加法器
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2024-10-17
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答案正确
| < 1ms | 0K | Verilog | |
235515 |
状态机与时钟分频
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2024-10-17
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答案正确
| < 1ms | 0K | Verilog | |
235509 |
脉冲同步器(快到慢)
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2024-10-16
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答案正确
| < 1ms | 0K | Verilog | |
235527 |
序列检测器(Moore型)
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2024-10-16
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答案正确
| < 1ms | 0K | Verilog | |
235491 |
使用握手信号实现跨时钟域数据传输
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2024-10-10
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答案正确
| < 1ms | 0K | Verilog | |
235499 |
根据RTL图编写Verilog程序
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2024-10-10
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答案正确
| < 1ms | 0K | Verilog | |
235511 |
并串转换
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2024-10-10
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答案正确
| < 1ms | 0K | Verilog | |
234312 |
使用3-8译码器①实现逻辑函数
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2024-09-12
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答案正确
| < 1ms | 0K | Verilog | |
234312 |
使用3-8译码器①实现逻辑函数
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2024-09-12
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答案正确
| < 1ms | 0K | Verilog | |
234314 |
数据选择器实现逻辑电路
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2024-09-12
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答案正确
| < 1ms | 0K | Verilog | |
234314 |
数据选择器实现逻辑电路
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2024-09-12
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答案正确
| < 1ms | 0K | Verilog | |
235521 |
自动售卖机
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2024-07-08
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答案正确
| < 1ms | 0K | Verilog |
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