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汕头市业余大学
2024
FPGA工程师
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题解
235499
根据RTL图编写Verilog程序
2023-05-27
答案正确
< 1ms
0K
Verilog
HJ1
字符串最后一个单词的长度
2023-04-25
答案正确
4ms
392K
C
VL30
数据串转并电路
2023-03-04
答案正确
< 1ms
0K
Verilog
VL29
信号发生器
2023-03-03
答案正确
< 1ms
0K
Verilog
VL28
输入序列不连续的序列检测
2023-03-03
答案正确
< 1ms
0K
Verilog
VL27
不重叠序列检测
2023-03-03
答案正确
< 1ms
0K
Verilog
VL26
含有无关项的序列检测
2023-02-25
答案正确
< 1ms
0K
Verilog
VL25
输入序列连续的序列检测
2023-02-22
答案正确
< 1ms
0K
Verilog
234351
边沿检测
2023-02-22
答案正确
< 1ms
0K
Verilog
234350
ROM的简单实现
2023-02-22
答案正确
< 1ms
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Verilog
234316
根据状态转移图实现时序电路
2023-02-22
答案正确
< 1ms
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Verilog
234315
根据状态转移表实现时序电路
2023-02-22
答案正确
< 1ms
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Verilog
234314
数据选择器实现逻辑电路
2023-02-21
答案正确
< 1ms
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Verilog
234312
使用3-8译码器①实现逻辑函数
2023-02-21
答案正确
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Verilog
234311
实现3-8译码器①
2023-02-21
答案正确
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Verilog
234313
用3-8译码器实现全减器
2023-02-21
答案正确
< 1ms
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Verilog
234310
使用8线-3线优先编码器Ⅰ实现16线-4线优先编码器
2023-02-21
答案正确
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Verilog
234309
优先编码器Ⅰ
2023-02-21
答案正确
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Verilog
234308
用优先编码器①实现键盘编码电路
2023-02-21
答案正确
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Verilog
234307
优先编码器电路①
2023-02-21
答案正确
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Verilog

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