牛客399696698号 - 个人主页刷题动态

235499	根据RTL图编写Verilog程序	2024-10-16	答案正确	< 1ms	0K	Verilog	题解
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235493	异步复位同步释放	2024-10-16	答案正确	< 1ms	0K	Verilog	题解
235503	任意奇数倍时钟分频	2024-10-13	答案正确	< 1ms	0K	Verilog	题解
235507	全加器	2024-10-13	答案正确	< 1ms	0K	Verilog	题解
235527	序列检测器（Moore型）	2024-10-13	答案正确	< 1ms	0K	Verilog	题解
234350	ROM的简单实现	2024-10-13	答案正确	< 1ms	0K	Verilog	题解
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234316	根据状态转移图实现时序电路	2024-10-13	答案正确	< 1ms	0K	Verilog	题解
234315	根据状态转移表实现时序电路	2024-10-13	答案正确	< 1ms	0K	Verilog	题解
234315	根据状态转移表实现时序电路	2024-10-13	答案正确	< 1ms	0K	Verilog	题解
234315	根据状态转移表实现时序电路	2024-10-13	答案正确	< 1ms	0K	Verilog	题解
234315	根据状态转移表实现时序电路	2024-10-13	答案正确	< 1ms	0K	Verilog	题解
234315	根据状态转移表实现时序电路	2024-10-13	答案正确	< 1ms	0K	Verilog	题解
234349	使用函数实现数据大小端转换	2024-10-11	答案正确	< 1ms	0K	Verilog	题解
234348	使用子模块实现三输入数的大小比较	2024-10-11	答案正确	< 1ms	0K	Verilog	题解
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