题号 | 题目 | 提交时间 | 状态 | 运行时间 | 占用内存 | 使用语言 | 题解 |
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235525 |
同步FIFO
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2023-09-17
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答案正确
| < 1ms | 0K | Verilog | |
235525 |
同步FIFO
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2023-09-17
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答案正确
| < 1ms | 0K | Verilog | |
235507 |
全加器
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2023-04-21
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答案正确
| < 1ms | 0K | Verilog | |
VL53 |
单端口RAM
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2022-10-08
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答案正确
| < 1ms | 0K | Verilog | |
VL29 |
信号发生器
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2022-10-08
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答案正确
| < 1ms | 0K | Verilog | |
VL28 |
输入序列不连续的序列检测
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2022-10-08
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答案正确
| < 1ms | 0K | Verilog | |
VL27 |
不重叠序列检测
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2022-10-08
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答案正确
| < 1ms | 0K | Verilog | |
VL27 |
不重叠序列检测
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2022-10-08
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答案正确
| < 1ms | 0K | Verilog | |
VL26 |
含有无关项的序列检测
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2022-10-07
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答案正确
| < 1ms | 0K | Verilog | |
VL25 |
输入序列连续的序列检测
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2022-10-07
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答案正确
| < 1ms | 0K | Verilog | |
VL25 |
输入序列连续的序列检测
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2022-10-07
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答案正确
| < 1ms | 0K | Verilog | |
234351 |
边沿检测
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2022-10-07
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答案正确
| < 1ms | 0K | Verilog | |
234350 |
ROM的简单实现
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2022-10-05
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答案正确
| < 1ms | 0K | Verilog | |
234307 |
优先编码器电路①
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2022-10-05
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答案正确
| < 1ms | 0K | Verilog | |
234306 |
4bit超前进位加法器电路
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2022-10-05
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答案正确
| < 1ms | 0K | Verilog | |
234305 |
4位数值比较器电路
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2022-10-04
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答案正确
| < 1ms | 0K | Verilog | |
234305 |
4位数值比较器电路
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2022-10-04
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答案正确
| < 1ms | 0K | Verilog | |
234349 |
使用函数实现数据大小端转换
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2022-10-04
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答案正确
| < 1ms | 0K | Verilog | |
234348 |
使用子模块实现三输入数的大小比较
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2022-10-04
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答案正确
| < 1ms | 0K | Verilog | |
234348 |
使用子模块实现三输入数的大小比较
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2022-10-04
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答案正确
| < 1ms | 0K | Verilog |
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