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比特大陆_IC Soc部_逻辑设计与验证工程师 获赞
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男 北京航空航天大学 2023 集成电路IC设计 IP属地：北京暂未填写个人简介
题号 | 题目 | 提交时间 | 状态 | 运行时间 | 占用内存 | 使用语言 | 题解 |
|---|
VL29 |
信号发生器
|
2022-08-03
|
答案正确
| < 1ms | 0K | Verilog | |
VL29 |
信号发生器
|
2022-08-03
|
答案正确
| < 1ms | 0K | Verilog | |
VL28 |
输入序列不连续的序列检测
|
2022-08-03
|
答案正确
| < 1ms | 0K | Verilog | |
VL28 |
输入序列不连续的序列检测
|
2022-08-03
|
答案正确
| < 1ms | 0K | Verilog | |
VL28 |
输入序列不连续的序列检测
|
2022-08-03
|
答案正确
| < 1ms | 0K | Verilog | |
VL27 |
不重叠序列检测
|
2022-08-03
|
答案正确
| < 1ms | 0K | Verilog | |
VL27 |
不重叠序列检测
|
2022-08-03
|
答案正确
| < 1ms | 0K | Verilog | |
VL26 |
含有无关项的序列检测
|
2022-08-03
|
答案正确
| < 1ms | 0K | Verilog |
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