题号 | 题目 | 提交时间 | 状态 | 运行时间 | 占用内存 | 使用语言 | 题解 |
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235491 |
使用握手信号实现跨时钟域数据传输
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2024-10-20
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答案正确
| < 1ms | 0K | Verilog | |
235499 |
根据RTL图编写Verilog程序
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2024-10-20
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答案正确
| < 1ms | 0K | Verilog | |
235503 |
任意奇数倍时钟分频
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2024-10-17
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答案正确
| < 1ms | 0K | Verilog | |
235503 |
任意奇数倍时钟分频
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2024-10-17
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答案正确
| < 1ms | 0K | Verilog | |
235497 |
序列发生器
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2024-10-17
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答案正确
| < 1ms | 0K | Verilog | |
235517 |
超前进位加法器
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2024-10-16
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答案正确
| < 1ms | 0K | Verilog | |
235515 |
状态机与时钟分频
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2024-10-16
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答案正确
| < 1ms | 0K | Verilog | |
235511 |
并串转换
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2024-10-15
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答案正确
| < 1ms | 0K | Verilog | |
235525 |
同步FIFO
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2024-09-27
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答案正确
| < 1ms | 0K | Verilog | |
235503 |
任意奇数倍时钟分频
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2024-04-10
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答案正确
| < 1ms | 0K | Verilog | |
235503 |
任意奇数倍时钟分频
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2024-04-10
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答案正确
| < 1ms | 0K | Verilog | |
235493 |
异步复位同步释放
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2024-04-10
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答案正确
| < 1ms | 0K | Verilog | |
235505 |
串行进位加法器
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2024-04-09
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答案正确
| < 1ms | 0K | Verilog | |
235505 |
串行进位加法器
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2024-04-09
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答案正确
| < 1ms | 0K | Verilog | |
235507 |
全加器
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2024-04-09
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答案正确
| < 1ms | 0K | Verilog | |
235527 |
序列检测器(Moore型)
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2024-04-09
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答案正确
| < 1ms | 0K | Verilog | |
235527 |
序列检测器(Moore型)
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2024-04-09
|
答案正确
| < 1ms | 0K | Verilog | |
235497 |
序列发生器
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2024-04-09
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答案正确
| < 1ms | 0K | Verilog | |
NP100 |
重载运算
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2024-04-01
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答案正确
| 29ms | 4696K | Python 3 | |
NP99 |
修改属性2
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2024-04-01
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答案正确
| 30ms | 4696K | Python 3 |
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