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描述一个具有高电平有效异步复位的D触发器：复位信号rst为高

[单选题]
描述一个具有高电平有效异步复位的D触发器：复位信号rst为高时，输出q立即清零；否则在时钟上升沿采样输入d。以下always块的敏感列表中，哪个能正确实现？ 
  • always @(posedge clk)
  • always @(posedge clk or rst)
  • always @(posedge clk or posedge rst)
  • always @(clk or rst)
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Verilog
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