有一个全相联Cache系统,Cache由4个块构成,CPU送出的主存地址流序列为:2,12,9,12,2,8,7,5分别给出先进先出替换算法和最近最少使用替换算法的相应地址分配和操作。
访问序列 1 2 3 4 5 6 7 8
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