思特威FPGA一面

1.简单聊聊项目,然后根据简历问八股
2.简单讲讲lvds,信道偏移解决办法;
3.流水线设计的一般思路;
4.时序分析,时序违例处理方法,约束;
5.提高主频的方法有哪些;
6.axi总线,outstanding,设计outstanding主从需要注意什么;
7.跨时钟处理办法有哪些;
8. 设计异步FIFO需要注意什么;
9.还有一些情境题:新接手一个项目,时序违例报告怎么去看,怎么去优化
10.团队协作出现问题怎么办,遇到困难超出自己能力怎么办等相关问题
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03-31 14:46
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门头沟学院 Web前端
励志成为双港第一ja...:这其实很正常,离的太远了,他认为你不会来,就为了混个面试,而且成本很高,实习生都优先选本地高校。吃了地域的亏,所有很多时候地域可能比院校层次更重要。
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