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风清扬呀
2023-10-07 10:51
门头沟学院 集成电路IC设计
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瑞芯微大家有收到offer的吗?
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dywdmsys
合肥工业大学 集成电路IC设计
大家准备去么,瑞芯微的上海岗
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发布于 2023-10-14 12:21
上海
icer2
门头沟学院 模拟IC设计
有base上海模拟收到意向了吗
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发布于 2023-10-14 18:31
江苏
一个响亮的名字_5003
门头沟学院 数字IC前端设计
有人收到录用意向了吗,录用意向稳吗😅
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发布于 2023-10-11 19:18
江苏
我要守护我最爱的昆昆
西安电子科技大学 数字IC前端设计
没呢 问hr就说待定 有投福州数字前端岗位的同学 收到通过短信了吗😭
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发布于 2023-10-09 10:10
陕西
暂无评论,快来抢首评~
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09-30 23:57
中国科学院高能物理研究所 FPGA工程师
#瑞芯微笔试
这是我目前做的最专业的一个笔试了岗位:数字IC设计工程师时长:120min,真的是刚好够用;题型:单选10道,20分;简答题:8道,80分;(1)单选,不太记得所有的了,写一下记得的吧:STA关键路径指的是什么? --- >最大的路径时沿;AHB总线协议里面,表示传输类型的信号?--> HTRANS;建立时间违例的改善方法?AXI哪个特性支持乱序完成?-->out of order;降低动态功耗的办法?哪个是非阻塞的总线协议?-->SPI什么叫同步时钟?--->同一个PLL产生的两个50M时钟(相位固定)(2)简答:写一个单bit脉冲信号跨时钟域的代码:同步异步F...
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10-14 22:26
东南大学 集成电路IC设计
瑞芯微发offer了吗
求问,有没有佬已经收到了ASR翱捷、睿思芯科、壁仞、恒玄科技、泰凌微、艾为、中颖、格科微、杰华特、大疆、字节、兆易创新、裕太微、地平线、禾费、乐鑫、 硅谷数模、复旦微、星宸、芯动科技、汇顶、晶晨、瑞芯微、全志科技、小米、百度昆仑芯、阿里平头哥、商汤、旷视、芯擎英伟达、摩尔线程、沐曦、: 英伟达
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09-20 15:07
门头沟学院 数据分析师
瑞芯微一面—数字IC设计工程师
一面是技术面,1v1,聊了大概45min左右 首先自我介绍,介绍完了之后面试官沉默了一下,然后就考察项目了。 介绍一个最值得讨论的项目背景(只介绍背景),然后让我对着项目电路框图简单介绍数据流,某个具体模块的功能 八股参考1.功耗分类,以及具体含义2.从RTL层面如何降低静态功耗3.是否了解cache4.在写状态机的时候,如果下一个状态跳转有50个分支,应该如何优化
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09-19 11:44
电子科技大学 嵌入式软件工程师
TP-LINK普联-嵌入式软件工程师(offer)
5.29 一面 20min1.自我介绍2.简单描述一下有限状态机3.进程调度的理解?调度算法调度策略?4.可以在什么时机的时候进行调度5.用户态和内核态切换都有哪些方式?6.谈谈对计算机里面cash的理解?他有什么作用?缓冲谁?7.虚拟内存谈一下理解?为什么需要虚拟内存?直接操作物理内存不可以吗8.如果有一个十万行的代码有内存泄漏,怎么定位9.工具定位的原理会是什么呢10.堆和栈的区别11.反问5.30 二面 30min忘记记录了,此面大多数都是项目问题,八股很少6.4 三面 30min1.自我介绍2.实验室里面主要是做什么的3.项目里数据上报是通过什么上报的4.I2C支持多主吗5.怎么仲裁6.i2c都有哪几种速率7.空指针的sizeof是多少8.vaolate什么用?防止哪方面优化9.static关键字是什么用10.Risc-v架构寄存器都有哪些?系统有哪些是基于risc-v比较特定的东西11.用户态到内核态是不是只能系统调用?还有别的方式吗?12.什么情况下会报一个段错误13.兴趣爱好14.反问6.10 座谈6.11 offer(sp给的太少了 已拒)
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09-20 15:00
西安电子科技大学 芯片研发
瑞芯微 芯片设计面试
时长:40min1、自我介绍2、为什么选择我们公司3、项目比较出彩的点,追问,为什么4、异步电路本质5、为什么同步复位?不同步复位会怎么样?6、异步电路和同步电路的各自好处7、对DC了解吗8、如何降低功耗(器件层面高阈值器件9、手上offer情况不算特别难。比较中规中矩的面试。发面经攒人品。
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