在吃瓜的螺狮粉很喜欢耍游戏 level
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门头沟学院
2021
soc前端设计
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VL31
数据累加输出
2022-09-01
答案正确
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Verilog
VL31
数据累加输出
2022-09-01
答案正确
< 1ms
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Verilog
VL29
信号发生器
2022-08-29
答案正确
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Verilog
VL28
输入序列不连续的序列检测
2022-08-28
答案正确
< 1ms
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Verilog
VL27
不重叠序列检测
2022-08-28
答案正确
< 1ms
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Verilog
VL27
不重叠序列检测
2022-08-28
答案正确
< 1ms
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Verilog
VL27
不重叠序列检测
2022-08-28
答案正确
< 1ms
0K
Verilog
VL27
不重叠序列检测
2022-08-28
答案正确
< 1ms
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Verilog
VL26
含有无关项的序列检测
2022-08-28
答案正确
< 1ms
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Verilog
VL26
含有无关项的序列检测
2022-08-28
答案正确
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Verilog
VL26
含有无关项的序列检测
2022-08-27
答案正确
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Verilog
VL25
输入序列连续的序列检测
2022-08-27
答案正确
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Verilog
VL25
输入序列连续的序列检测
2022-08-27
答案正确
< 1ms
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Verilog
234309
优先编码器Ⅰ
2022-08-27
答案正确
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Verilog
234308
用优先编码器①实现键盘编码电路
2022-08-27
答案正确
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Verilog
234350
ROM的简单实现
2022-08-27
答案正确
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Verilog
234350
ROM的简单实现
2022-08-27
答案正确
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Verilog
234316
根据状态转移图实现时序电路
2022-08-26
答案正确
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Verilog
234315
根据状态转移表实现时序电路
2022-08-26
答案正确
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Verilog
234308
用优先编码器①实现键盘编码电路
2022-08-26
答案正确
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Verilog

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