题号 | 题目 | 提交时间 | 状态 | 运行时间 | 占用内存 | 使用语言 | 题解 |
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VL34 |
整数倍数据位宽转换8to16
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2022-08-10
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答案正确
| < 1ms | 0K | Verilog | |
234310 |
使用8线-3线优先编码器Ⅰ实现16线-4线优先编码器
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2022-08-08
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答案正确
| < 1ms | 0K | Verilog | |
234309 |
优先编码器Ⅰ
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2022-08-07
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答案正确
| < 1ms | 0K | Verilog | |
234314 |
数据选择器实现逻辑电路
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2022-08-01
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答案正确
| < 1ms | 0K | Verilog | |
234312 |
使用3-8译码器①实现逻辑函数
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2022-08-01
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答案正确
| < 1ms | 0K | Verilog | |
234311 |
实现3-8译码器①
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2022-08-01
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答案正确
| < 1ms | 0K | Verilog | |
234313 |
用3-8译码器实现全减器
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2022-08-01
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答案正确
| < 1ms | 0K | Verilog | |
234310 |
使用8线-3线优先编码器Ⅰ实现16线-4线优先编码器
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2022-08-01
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答案正确
| < 1ms | 0K | Verilog | |
234309 |
优先编码器Ⅰ
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2022-08-01
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答案正确
| < 1ms | 0K | Verilog | |
234308 |
用优先编码器①实现键盘编码电路
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2022-08-01
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答案正确
| < 1ms | 0K | Verilog | |
234315 |
根据状态转移表实现时序电路
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2022-07-31
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答案正确
| < 1ms | 0K | Verilog | |
234316 |
根据状态转移图实现时序电路
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2022-07-31
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答案正确
| < 1ms | 0K | Verilog | |
234350 |
ROM的简单实现
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2022-07-31
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答案正确
| < 1ms | 0K | Verilog | |
234351 |
边沿检测
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2022-07-31
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答案正确
| < 1ms | 0K | Verilog | |
234306 |
4bit超前进位加法器电路
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2022-07-31
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答案正确
| < 1ms | 0K | Verilog | |
VL58 |
游戏机计费程序
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2022-07-31
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答案正确
| < 1ms | 0K | Verilog | |
VL57 |
交通灯
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2022-07-31
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答案正确
| < 1ms | 0K | Verilog | |
VL56 |
流水线乘法器
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2022-07-30
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答案正确
| < 1ms | 0K | Verilog | |
VL55 |
Johnson Counter
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2022-07-29
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答案正确
| < 1ms | 0K | Verilog | |
VL54 |
RAM的简单实现
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2022-07-29
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答案正确
| < 1ms | 0K | Verilog |
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