题号 | 题目 | 提交时间 | 状态 | 运行时间 | 占用内存 | 使用语言 | 题解 |
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VL49 |
脉冲同步电路
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2023-08-25
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答案正确
| < 1ms | 0K | Verilog | |
VL49 |
脉冲同步电路
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2023-08-21
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答案正确
| < 1ms | 0K | Verilog | |
VL25 |
输入序列连续的序列检测
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2023-08-15
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答案正确
| < 1ms | 0K | Verilog | |
235523 |
十六进制计数器
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2023-08-02
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答案正确
| < 1ms | 0K | Verilog | |
235515 |
状态机与时钟分频
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2023-08-02
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答案正确
| < 1ms | 0K | Verilog | |
235511 |
并串转换
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2023-08-02
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答案正确
| < 1ms | 0K | Verilog | |
235497 |
序列发生器
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2023-08-01
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答案正确
| < 1ms | 0K | Verilog | |
235499 |
根据RTL图编写Verilog程序
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2023-08-01
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答案正确
| < 1ms | 0K | Verilog | |
234351 |
边沿检测
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2023-07-31
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答案正确
| < 1ms | 0K | Verilog | |
234350 |
ROM的简单实现
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2023-07-31
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答案正确
| < 1ms | 0K | Verilog | |
234316 |
根据状态转移图实现时序电路
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2023-07-31
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答案正确
| < 1ms | 0K | Verilog | |
234316 |
根据状态转移图实现时序电路
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2023-07-31
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答案正确
| < 1ms | 0K | Verilog | |
234315 |
根据状态转移表实现时序电路
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2023-07-31
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答案正确
| < 1ms | 0K | Verilog | |
234315 |
根据状态转移表实现时序电路
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2023-07-31
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答案正确
| < 1ms | 0K | Verilog | |
234307 |
优先编码器电路①
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2023-07-31
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答案正确
| < 1ms | 0K | Verilog | |
234305 |
4位数值比较器电路
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2023-07-30
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答案正确
| < 1ms | 0K | Verilog | |
234349 |
使用函数实现数据大小端转换
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2023-07-30
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答案正确
| < 1ms | 0K | Verilog | |
234349 |
使用函数实现数据大小端转换
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2023-07-30
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答案正确
| < 1ms | 0K | Verilog | |
234349 |
使用函数实现数据大小端转换
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2023-07-30
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答案正确
| < 1ms | 0K | Verilog | |
234348 |
使用子模块实现三输入数的大小比较
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2023-07-30
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答案正确
| < 1ms | 0K | Verilog |
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