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牛客465085738号
IC验证工程师
发布于江苏
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@FPGA探索者:
大疆2020校招数字IC笔试题解析(1)-芯片开发/FPGA
本文首发在【公众号——FPGA探索者】 单选1~10题及解析 1. 多 bit 跨时钟域 1. 下列关于多 bit 跨时钟域的处理思路,错误的有() 答案:A 解析: 多bit数据跨时钟域: 异步FIFO,格雷码(连续变化的地址/计数信号等),握手信号,DMUX 参考:CDC跨时钟域处理及相应的时序约束【set_clock_groups】【set_max_delay】【FPGA探索者】 2. 定点数量化 2. 对 12.918 做无损定点化,需要的最小位宽是多少位,位宽选择11位时的量化误差是多少? 答案:C 解析: (1)首先对于整数部分的12,至少需要4-bit量化; (2)对于小数部分的0.918,只要量化的误差小于数据最小精度的一半,就可以认为是无损量化。当小数部分使用8-bit量化时,0.918*(2^8)=235.008,即采用8-bit量化时的误差为0.008/(2^8)=0.00003125,数据0.918精确到0.001(小数点后第三位),量化误差小于数据最小精度的一半,满足“无损”量化,所以12-bit量化(整数4,小数8)可以满足“无损”。 当小数部分使用7-bit量化,0.918*(2^7)=117.504,量化误差为0.504/(2^7),显然量化误差大于精度的一半(0.504>0.5),不满足无损量化,量化误差为0.504/(2^7)=0.0039375。 如果按照四舍五入量化为118,误差也是大于0.0005的,不满足无损量化。 3. 噪声源均方误差 3. 两个噪声源的均方根噪声幅度分别是 10 uVrms,5uVrms;两个噪声源叠加后的均方根噪声幅度不可能是以下值中的哪个? 答案:B 解析: 原噪声均方根幅度X1、X2,叠加后的均方根噪声幅度X,满足: abs(X1-X2)<= X <= X1+X2 当两个噪声在任意时刻恰好幅度均能抵消,则取减号的等; 当两个噪声在任意时刻恰好幅度均能叠加,则取加号的等; 其他条件下,取中间区间; 所以,5 <= X <= 15,B 肯定不可能。 4. 关键路径 4. 考虑如下的 4*4 的“二维仲裁器”,R00 到 R33 为输入,G00 到 G33 为输出,N 和 W 也为输入,E 和 S 也为输出,假设所有的逻辑门(包括非门/与门/反相器)延时都为 1 ns,请问该电路的最大延迟为? 答案:D 解析: 每个 Arbiter 从输入到输出S 和E 延时3 ns,整个4*4仲裁器最长路径需要经过7个Arbiter,每个3 ns,一共 21 ns。 5. 时序逻辑运算 5. 下图所示 4 bit 右移位寄存器,0 时刻 ABCD 初始状态为 0111,请写出 5 个时刻以后的 ABCD 的输出? 答案:选B,但是此题实际没答案 解析: A(n+1)= ~(A(n)|B(n)|C(n)),当 A、B、C均为 0 时,下一时刻 A = 1,否则 A = 0; 0 时刻:ABCD = 0111 1 时刻:ABCD = 0011 2 时刻:ABCD = 0001 3 时刻:ABCD = 1000 4 时刻:ABCD = 0100 5 时刻:ABCD = 0010 6. 存储器相关问题 6. 1 个 16K * 8 位的存储器,其地址线和数据线总和是? 答案:D 解析: 8位可以确定8根数据总线; 16K和地址有关,1K是1024=2^10,所以16K=1K*16=(2^10)*(2^4)=2^14,需要14根地址总线; 共计需要8 + 14 =22; 扩展题目: 7. 原码和补码 7. 数字系统中,采用()可以将减法运算转化成为加法运算? 答案:D 解析: A – B =A + (-B); 对 B 取负数,即使用补码进行有符号数表示; 有符号数的加法和乘法运算,只有 2 个数均为有符号数,才按照有符号数运算,只有有 1 个是无符号数,就按照无符号数运算。 8. 流水线设计 8. 关于流水线设计的理解,错误的是()? 答案:A 流水线的实现方式: (1)插入寄存器(触发器Flip-Flop,FF)去分割延迟比较大的组合逻辑,消耗了更多的触发器,组合逻辑资源不变(理论上); (2)由于增加了寄存器,每增加一级寄存器就会对数据寄存一个时钟周期,所以对于单个数据来讲,从输入到输出的延时增加; (3)对于整体来讲,速度提升,最大工作频率提高,是典型的面积换速度的思想。 9. 位拼接 9. 在 Verilog 语言中,如果 a =1’b1,b = 3’b101,c = 1’b0,则 {a, {3{c}}, b} = ? 答案:C 解析: {} 位拼接,前面的放高位; {3{c}} 是将 c 复制 3 份,等效于 {c, c, c},结果为 3’b000; 总的结果为 {1’b1, 3’b0, 3’b101},即 7’b1000101; 10. 逻辑门 10. 下面哪种逻辑门可以实现逻辑 (A XOR B) OR (C AND D)? 答案:A 解析: (A XORB) OR (C AND D) = A^B + CD = AB’ + A’B + CD = (…)’ 本文首发在【公众号——FPGA探索者】
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会编程的太平湖水怪就要上岸了
05-15 13:31
重庆理工大学 计算机类
实习应该学到什么东西?
公司技术栈是阿里那一套,但我目前能接触到的只有CRUD,对整个工作流程和系统架构了解尚浅。关键是没有文档可以看......想要看懂系统只能看源码......说实话看起来有点痛苦,多而杂,系统迭代过两次,有些业务逻辑没点时间根本理不清不太清楚该怎么学到东西,现在我的理解是要么学技术栈,要么学业务,但不知道对不对: 1 把微服务技术栈(sofa+k8s)学了 2 把项目核心模块学了(代码杂而多,没文档,难度大,但感觉能啃下来肯定更有帮助)
投递阿里巴巴等公司10个岗位 >
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新时代八股战士
昨天 16:42
门头沟学院 电子信息类
暑期实习结尾了...
分享下阿里大文娱优酷后端开发时间线4.12投简历4.15笔试4.26一面5.9二面5.17 上午11.30hr面一共十分钟5.17 中午12.出头 hr面结束20分钟就发录取意向了当天下午加了hr微信 聊了入职薪资+预约体检。感觉 一套流程下来 花了整整一个多月,等待过程挺煎熬的后续还有字节的笔试以及一些其他厂流程中都不太想面了 累了。。。其实5.13日就已经入职了一家杭州小公司,现在打算离职。。。这小公司真的感觉压力拉满 入职第一天 直接姐需求写代码 还有老员工催你干活 挺恶心的哈哈哈
投递优酷等公司10个岗位 >
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随便找个班混日子
05-09 00:54
已编辑
前端工程师
唉,时代变了
#前端开发#前端#
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牛客172052690号
03-27 18:13
湖南工程学院应用技术学院 物流管理与工程类
求大神修改简历 根本找不到工作 我太菜了😭😭😭
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一箬烟雨
05-16 10:43
四川大学 计算机类
盒马 5-14 电话1面
25分钟 没怎么问八股通用项目问题pv如果上升至10倍,你应该怎么调整你的框架,保证服务不崩掉自旋锁缓存击穿和缓存穿透项目大概聊了15分钟手撕 只需要讲思路***********如何用o1 空间 on时间的解法总结最好是项目和面试官聊的开心,然后笔试ak(做这么多也就盒马的ak了)。所以算法和项目的逻辑性要好一点希望能蹲个二面,盒马天天电话面,很猝不及防
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