oppo芯片工程师社招面经

oppo

oppo社招,无笔试,之前面试的几家公司只有vivo是有笔试的,其他都没有笔试,oppo面试一对一,面试30分钟左右。oppo面试官是一个女生,有点点小惊讶,毕竟一直听说oppo是不怎么招女生的。

1、一面

oppo面试也是主要问项目,但是感觉她不了解我做的项目,所以主要是我在说(汇顶和中兴的很懂,问的很细致)。

问到的有:

1、简单自我介绍一下自己的项目,然后让仔细的说了其中几个模块是怎么实现的

2、FPGA怎么供时钟的,and why?

3、FIFO的设计,FIFO设计时应该注意哪些?

4、FIFO在设计时,对读写时钟有没有要求,需不需要要求读写时钟不能差距过大?

5、FPGA约束,涉及到哪些约束

6、RAM按端口分有哪些种类

7、时序问题如何解决

8、跨时钟域的处理,并举出项目中的例子

9、怎么确保自己所调试的模块是没问题的

10、项目是在怎么形成的,指标对比

11、项目中最困难的模块

12、除了所做项目,有没有调试过其他项目

13、最大的优缺点,并举例子

2、二面

据说二面也是技术面,于是认认真真准备了,但是面试过程过于惊讶。十分钟解决,一面面试官和二面面试官一直都有说,我做FPGA的实现和他们IC还是不一样,不契合,预估凉凉。

二面主要也没问什么技术问题,主要还是问项目构成,具体模块的编写,调试,IC的设计流程是否了解(从前端到后端),以及和FPGA设计的区别,时序约束的学习过程,时序怎么约束,时序约束的作用,代码编写验证以及上板调试验证。

#芯片设计工程师##社招##面经##OPPO#
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卡学历不
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发布于 2021-03-29 23:22
老哥面试那个部门?
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发布于 2021-03-04 17:04
小红书
校招火热招聘中
官网直投
楼主几年经验了?
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发布于 2021-03-06 23:06

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暑期实习投递记录:投递美国岗位:89      面试:1(凉)投递国内岗位:10个左右 没具体记录 面试:1(凉)TSMC - SRAM Design Intern (San Jose)一面:entry-level engineer面的我,共三十分钟。前十分钟自我介绍以及公司介绍,发现对方是校友哈哈哈。后二十分钟介绍简历项目,简单问了三个问题,首先是时序分析:setup time和hold time哪一个更需要被重视?第二个问题:transistor宽度(width)对电路static power,switch power以及delay的影响。第三个问题什么是logical effort,作用是什么二面:Hiring manager 面(综合了其他收到面试的同学的记录) 共四十分钟,全程技术面,难度不大。 首先画Vgs 与Id的曲线 以及Vds与Id的曲线,然后画short channel effect的曲线。第二个问题,针对pmos nmos transitor  给端点比如Drain特定电压求另一端比如source的最大可能电压。然后画inv, 将pmos nmos位置互换,给一串输入信号(0110)分析此时的输出。第三个问题:时序分析,两个FF组成一个stage,列出setup time和hold time的不等式,往两个FF的clk上分别加buffer对setup和hold的影响。提出解决setup violation和hold violation的办法。 第四个问题:简单对电容进行公式分析(高中物理)第五个问题:手搓transitor level的FF第六个问题:根据equation手搓对应的pmos和nmos组成的上拉下拉电路,涉及到公式化简以及香农展开第七个问题:手搓SRAM,分析输入输出总之,还是很基本的问题,奈何当时并没有学到SRAM,所以在项目上并不是很匹配。国内基本没投多少,收到了NXP 天津的面试,感觉像是kpi 面,岗位要求是digital design 感觉应该是ASIC design就投了,结果面试官一开始面试说要找DV的候选人,然后我就凉了 #集成电路IC设计#  #硬件人求职现状#  #本周投递记录#
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