许愿华为性格测评和捞人
2021.9.28，今天刚面试完华为的3面，写一下面经许愿性格测评和捞人
lz本硕都是北京某211，面试的华为数通的单板硬件开发
一面：
约的14:30，结果面试官在开会拖了1小时，是一个比较和蔼的中年男面试官
lz硕士做的挺杂的，DSP、FPGA、电路设计都做过，简历也都写了。这里提醒一下各位，简历慎重写，lz投的单板硬件开发，但是因为简历项目写了用FPGA导致一面二面各种问FPGA和数字电路，反倒是模拟电路设计没怎么问，lz准备的更多的是模拟电路知识，差点出事。
面试主要是针对FPGA和数电问的，首先问了lz设计的一个AD采样板的框图，问了项目中FPGA负责了哪部分，让画了一下比如FPGA控制AD读写的时序，FPGA和DSP是怎么通信的（我用的是EMIF），然后他问了这个总线的接口信号都有哪些。还问了我以太网传输的PHY和RJ45接没接变压器，（其实没接）但我当时忘了，而且之前复习过应该有这么个传感器来进行隔离抗干扰再进行电平匹配，我就说的有，他也没深入问。
可能由于等的时间比较长，面试管跟我说你项目经常用AD，有道AD转换的题肯定会，就不给你做了。然后就做了一道Verilog题，是一个25MHz的信号，需要每1Hz输出一个高电平，高电平持续时间是1/25us(就是前面那个25MHz的一个周期)，挺简单的，一个count计数就行，注意计算是0到24999，我刚开始写25000被提醒了。（lz其实挺马虎的)
二面:
差不多一面结束十分钟发恭喜通过消息，然后再过一会二面。
是个女面试官，也挺和蔼的，但是lz感觉二面结果不是很好
基本和一面面试内容一样，倒是问了一些同步通信的知识，问我项目的某个通信是不是同步的，也是问了我DSP和FPGA的通信接口，时序，AD采样时序
然后就做题，第一道是一个D触发器检测时钟下降沿问有没有什么问题，当时我一看就有点凉，因为我数电都是复习的理想理论，不知道实际中一些毛刺干扰到底有没有。D触发器他是D接了高电平，IN接反相器接时钟，有一个清零控制管脚，输出需要在检测到下降沿之后保持高电平，其他管脚没画。我说没啥问题，她说有毛刺，我现在也不懂。
然后第二道题，给了一个简单的Verilog赋值，一边是阻塞（y=in;b=y;）一边是非阻塞（y<=in;b<=y;），让我画综合后的电路，这我一点不会，我问她能不能画时序，她说可以。这还行，非阻塞赋值是同时赋值这些语句，阻塞是上一个赋值完再赋值下一个，然后我画的大概就是非阻塞赋值最后的b会晚一个时钟。（我顺序忘了，然后2个时序图画反了，然后用文字标注了出来，她没看到文字说我画反了，后来我说我用文字标了）
然后第三道题，（感觉应该是我第一道答的不行导致有第三道）
一道AD数据转电压的题，非常简单：1
2位逐次逼近型AD，线性测温，12‘h002温度为0.125℃，12‘hffe温度为-0.125℃。
2位逐次逼近型AD，线性测温，12‘h002温度为0.125℃，12‘hffe温度为-0.125℃。 1.12’h190多少温度（25）
2.12’he70多少温度（这两问考的是补码，正数补码为本身，负数要取反加1）（-25）
3.写一下数据与温度的对应关系式（也是考补码，看着写就行，我是按data为无符号数写的）
4.温度范围-10-80，设计超温报警，假设数据已经存到了12位的一个REG信号data里,超过温度范围的话令flag为0。（其实关键也是将温度转成12位2进制数据，注意Verilog也是无符号数就行了，判断范围用的逻辑是&&还是||仔细考虑一下别写反了）
题目都还挺简单的，lz老做题家了
三面：
二面结束的时候，面试官说了句今天的面试先到这后续会有HR联系你，我还以为凉了。然后过了好几十分钟才收到恭喜通过的短信(可能我答的确实不行)
HR说预计8点，实际也差不多，三面时间挺短的，就20来分钟。
三面也是问了一下项目，简单介绍一下思路，不会细问，然后就是问一下参加了什么社团、电子竞赛；项目中有没有与他人沟通；为什么来投华为，为什么投单板；说是华为最近也是面临制裁有没有从同学听说过华为，还有最重要的就是加班问题怎么看待。然后问了一下哪的人。
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