我去这都可以
ROM的简单实现
http://www.nowcoder.com/practice/b76fdef7ffa747909b0ea46e0d13738a
`timescale 1ns/1ns
module rom(
input clk,
input rst_n,
input [7:0]addr,
output [3:0]data
);
reg [3:0]p=0;
always@(posedge clk or negedge rst_n or negedge clk)begin
if(!rst_n)
p<=0;
else begin
p<=addr*2;
end
end
assign data=p;
endmodule
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